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接近度比较器323可被配置为数字电路，该数字电路将样本寄存器403中存储的IDROOP数字样本与保持寄存器409中的数字值进行比较，用于在对于保持条件而将HOLD断言为高时进行接近度确定。在本情形中，ΔI可以由数字接近度值来表示。在一个数字配置实施例中，在保持条件期间，向保持寄存器409中存储的数字保持值添加或从其扣除数字接近度值以提供数字接近度范围，并且将上、下数字接近度范围值与在样本寄存器403中更新的样本值进行比较，以进行接近度确定。

[0048]图9是时序图，其中相对于时间绘制了SVID、DVID、STRT、STOP、VREF、VOUT、ILSENS、IDROOP,HOLD、IDRP、PROX和TRD信号，示出图3所示调制器103在通过和保持条件期间响应于一对SVID命令的操作。应该注意，SVID以简化形式被绘制为高/低逻辑信号。所示SVID信号表示时间包络，其中时钟/数据线正在向调节器控制器传送串行数据以改变输出电压。描绘VREF+ΛVl和VREF-Λ Vl的一对虚线与VOUT—起绘出，并且描绘IDRP土 ΛI的另一对虚线与IDRP—起绘出。SVID以简化形式示出，其中它正常情况下为高并且在SVID命令被提供时被拉低。[0049]在初始时间t0，SVID被拉低，指示新的SVID指令开始。剩余信号被示为处于初始电平。在tl处SVID命令完成时，SVID被拉高，且VID设置网络313将DVID断言为高，以在控制器改变VID值时指示DAC变化。响应于DVID走高，脉冲设备315在STRT上断言脉冲，导致SR锁存器317将HOLD信号锁存为高。

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EV210A2.5SS G 14F NC000 032H8895 EV210A 2.5SS N14F NC000032H8041 EV210A3.0SS G

14F NC000 032H8043 EV210A3.5SS G 14F NC000 032H8047 EV210A1.5SSG 14E NC000